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1/46逻辑电路组合逻辑电路时序逻辑电路现时的输出仅取决于现时的输入除与现时输入有关外还与原状态有关3.4集成组合逻辑电路2/46构成:1.由各类逻辑门组成,电路中不含存储元件。2.输入和输出之间没有反馈通路。3.4.1组合逻辑电路输入输出的特点特点:电路在任意时刻的输出仅仅取决于该时刻的输入,而与电路以前的状态无关。3/46分析步骤:1)由给定的逻辑图写出逻辑关系表达式。2)用逻辑代数或卡诺图对逻辑代数进行化简。3)列出输入输出状态表并得出结论。电路结构输入输出之间的逻辑关系3.4.2组合逻辑电路的分析、设计方法及步骤1.组合逻辑电路的分析4/46【例】分析下列电路的功能。第一步,写逻辑表达式,并化简。5/46第二步,列写真值表。输入输出输入输出ABSCABSC0000101001101101第三步,分析真值表电路可实现两个1位二进制相加,称半加器。6/46&2&3&4AMB1F=101被封锁11例:分析下图的逻辑功能。7/46&2&3&4AMB1F=010被封锁1分析结果:选通电路8/46任务要求最简单的逻辑电路1)根据实际问题的逻辑含义,列出真值表。2)由真值表写出逻辑表达式。3)对逻辑表达式进行化简。4)根据最简逻辑表达式画出逻辑电路图。设计步骤:2.组合逻辑电路的设计方法及步骤9/46例:设计三人表决电路(A、B、C)。每人一个按键,如果同意则按下,不同意则不按。结果用指示灯表示,多数同意时指示灯亮,否则不亮。1)首先指明逻辑符号取“0”、“1”的含义。三个按键A、B、C按下时为“1”,不按时为“0”。输出是F,多数赞成时是“1”,否则是“0”。2)根据题意列出逻辑状态真值表。10/46ABCF00000010010001111000101111011111逻辑真值表3)由真值表写出逻辑表达式:ABCCABCBABCAF11/464)用卡诺图化简逻辑表达式:ABC000111100100100111ABACBCACBCABF12/465)根据逻辑表达式画出逻辑图。ACBCABF&1&&ABBCF13/46CABCABCABCAB&&&&ABCFCABCABF若用与非门实现14/463.4.3编码器、译码器、显示器、多路选择器及多路分配器的原理和应用1)编码器所谓编码就是赋予选定的一系列二进制代码以固定的含义。n个二进制代码(n位输出)有2n种不同的组合,可以表示2n个信号(2n位输入)。二进制编码器将一系列信号状态编制成二进制代码。15/46例:用与非门组成三位二进制编码器设八个输入端为I1I8,八种状态,与之对应的输出设为F1、F2、F3,共三位二进制数。设计编码器的过程与设计一般的组合逻辑电路相同,首先要列出状态表,然后写出逻辑表达式并进行化简,最后画出逻辑图。16/46I1I2I3I4I5I6I7I8F3F2F10111111100010111111001110111110101110111101111110111100111110111011111110111011111110111真值表86421IIIIF8642IIII87432IIIIF87653IIIIF17/46I1I2I3I4I5I6I7I8&&&F3F2F18-3编码器逻辑图18/462)译码器译码是编码的逆过程,即将某二进制翻译成电路的某种状态。二进制译码器将n种输入的组合译成2n种电路状态。也叫n---2n线译码器。译码器的输入:一组二进制代码译码器的输出:一组高低电平信号19/46&&&&1Y0Y2Y3YA1A0S2-4线译码器74LS139的内部线路输入控制端输出20/4674LS139的功能表A1A01XX11110000111001101101011010111110S0Y1Y2Y3Y“—”表示低电平有效。21/463)显示译码器二-十进制编码显示译码器显示器件在数字系统中,常常需要将运算结果用人们习惯的十进制显示出来,这就要用到显示译码器。22/46共阴极显示器共阳极显示器段组合七段显示器件23/46显示器件显示原理:abcdfg输入输出显示A3A2A1A0abcdefg000011111100000001100001001010110112e24/46显示译码器电路:25/464)数据选择器从一组数据中选择一路信号进行传输的电路,称为数据选择器。A0A1D3D2D1D0W控制信号输入信号输出信号数据选择器类似一个多投开关。选择哪一路信号由相应的一组控制信号控制。26/46四选一数据选择器,当G=0时,输出Y=Di,i由地址线BA四种状态确定。当G=1时,所有的与门都被封锁,Y总为0。27/46输入输出BAY10000D0010D1100D2110D3G功能表控制端28/465)数据分配器•将一路输入数据分配到多路输出端的电路称为数据分配器。由地址(编码)控制端来确定选择哪路输出信号。29/46(1)加法器3.4.4加法器、数码比较器、存储器、可编程逻辑阵列的原理和应用1)逢二进一。2)最低位是两个数最低位的叠加,不需考虑进位。3)其余各位都是三个数相加,包括加数、被、加数和低位来的进位。4)任何位相加都产生两个结果:本位和、向高位的进位。30/46半加器:半加运算不考虑从低位来的进位A---加数;B---被加数;S---本位和;C---进位。ABCS0000010110011110真值表31/46ABCS0000010110011110真值表BABABASABC32/46=1&ABSC逻辑图半加器ABCS逻辑符号33/46全加器:an---加数;bn---被加数;cn-1---低位的进位;sn---本位和;cn---进位。逻辑状态表见下页34/46anbncn-1sncn00000001100101001101100101010111001111111nnnnnnc)baba(c)baba(snnnnnnn1nnnnnbac)baba(cn35/461nnnnnnc)baba(c)baba(snnnnnnn1nnnnnbac)baba(cnnnbabasnnnnbannbabasnn111nnncscscssnnn1nnbascc半加和:所以:36/46anbncn-1sncn全加器逻辑图逻辑符号37/46应用举例:用一片SN74LS183构成两位串行进位全加器。bncn-1sncn全加器anbncn-1sncn全加器anA2A1B2B1D2D1C串行进位38/46(2)数码比较器比较器的分类:1)仅比较两个数是否相等。2)除比较两个数是否相等外,还要比较两个数的大小。第一类的逻辑功能较简单,下面重点介绍第二类比较器。39/461)一位数值比较器输入输出ABABA=BAB00010010011010011010功能表40/46输入输出ABABA=BAB00010010011010011010BABA”“ABBABA”“BABA”“41/46&&1ABABABA=BABABABA=B逻辑图逻辑符号42/46(3)半导体存储器分为只读存储器(ROM)和随机存储器(RAM)1)半导体存储器的特点ROM的特点:只能读出,不能写入;掉电后信息不丢失。RAM的特点:可读可写;掉电后信息丢失。2)半导体存储器的结构(略)43/46(4)可编程逻辑器件(PLD的原理和应用)PLD表示法在芯片内部配置和逻辑图之间建立了一一对应的关系,并将逻辑图和真值表结合起来,形成了一种紧凑而易于识读的表达形式44/46PLD的连接方式45/46基本门电路PLD的表示法与门符号或门符号46/46例子:BAZBABABAY
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